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Si570/Si571
2. Electrical Specifications
Table 1. Recommended Operating Conditions
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
3.3 V option
2.97
3.3
3.63
Supply Voltage
1
V DD
2.5 V option
2.25
2.5
2.75
V
1.8 V option
1.71
1.8
1.89
Output enabled
LVPECL
—
120
130
Supply Current
I DD
CML
LVDS
—
—
108
99
117
108
mA
CMOS
TriState mode
—
—
90
60
98
75
Output Enable (OE) ,
2
V IH
0.75 x V DD
—
—
Serial Data (SDA),
Serial Clock (SCL)
Operating Temperature Range
T A
V IL
—
–40
—
—
0.5
85
V
oC
Notes:
1. Selectable parameter specified by part number. See Section "7. Ordering Information" on page 27 for further details.
2. OE pin includes a 17 k ? pullup resistor to V DD . See “7.Ordering Information”.
Table 2. V C Control Voltage Input
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
33
45
Control Voltage Tuning Slope 1,2,3
K V
V C 10 to 90% of V DD
—
90
135
—
ppm/V
180
356
Control Voltage Linearity 4
Modulation Bandwidth
V C Input Impedance
Nominal Control Voltage
Control Voltage Tuning Range
L VC
BW
Z VC
V CNOM
V C
BSL
Incremental
@ f O
–5
–10
9.3
500
—
0
±1
±5
10.0
—
V DD /2
+5
+10
10.7
—
—
V DD
%
kHz
k ?
V
V
Notes:
1. Positive slope; selectable option by part number. See "7. Ordering Information" on page 27.
2. For best jitter and phase noise performance, always choose the smallest K V that meets the application’s minimum APR
requirements. See “AN266: VCXO Tuning Slope (K V ), Stability, and Absolute Pull Range (APR)” for more information.
3. K V variation is ±10% of typical values.
4. BSL determined from deviation from best straight line fit with V C ranging from 10 to 90% of V DD . Incremental slope is
determined with V C ranging from 10 to 90% of V DD .
Rev. 1.4
5
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